application n°2 (marine) navire à cycle combiné
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Application n°2 (marine)Navire à cycle combiné
Charles MODIGUY (CS)Nhan TRUONG-TRUNG (CS)Pascal PICARD (SITIA)David DELUCA (SITIA)
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
SOMMAIRE
Présentation générale de l’application marineDéveloppement UML SignalDéveloppement SynDEx
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Présentation générale de l’application marine
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NDNB
QEA
QCIR
QV
V6100V6170
9MW
25MW
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
TAGPODs
Recirculation
vapeur
eauEnergie
Thermique (échappement)
Ballon
Vap.
Dégazeur
TAVCOND
Eau.Energie
Mécanique / ElectriqueV6170
V6100
Qv
NB
ND
Qea
Qcond
Cycle combiné : schéma général
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SNCC du navire à cycle combiné
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Choix des processus étudiés § Ballon vapeur et son contrôle commande (BAL, CCBAL)§ Dégazeur et son contrôle commande (DEG, CCDEG)§ Turbine à gaz (TAG, CCTAG)
Modélisation du ballon vapeur § Processus : obtenu à partir de résultats expérimentaux§ Contrôle commande : donné par CAT
Modélisation du dégazeur § Processus : modèle de connaissance + recalage à partir des essais en mer§ Contrôle commande : donné par CAT (du même type que pour le ballon vapeur)
Modélisation de la Turbine à gaz § Processus : modèle interne (bibliothèque SITIA + avis CAT)§ Contrôle commande : idem
Connaissance et validation des processus et leurs contrôle commande continus§ Développement et simulation sous Matlab Simulink § Développement et simulation sous Scilab Scicos
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Schéma bloc du processus Ballon avec son contrôle commande
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Equations du système
Identification de la fonction de transfert NB/QEACelle-ci est obtenue à partir de résultats expérimentaux.
où p désigne la variable de Laplace.
Identification de la fonction de transfert NB/QVCelle-ci est obtenue à partir de résultats expérimentaux
où p désigne la variable de Laplace.
Méthode d’identification utiliséeMéthode du maximum de vraisemblance sur modèle d’état avec conditions initiales (SITIA-ECN)
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pGbpGbpGb
KcorGKgG(p)(p)
QEANB
⋅+⋅+⋅
⋅==
12
23
3
)()(1
22
33
1pFbpFbpFb
p]–To[ KfpFpQvNB
⋅+⋅+⋅⋅⋅==
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Contrôle commande du niveau ballon : régulations PI suivant les régimesDonnées : Chantiers de l’Atlantique
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Loi de commande du régulateur
Régulation 3E (Qv>QvSeuil)
où KcorG, Kp et Ti sont des constantes
Régulation 1E (Qv<QvSeuil)
)(11
NBNBCpTi
KpKcorG
QEA −
⋅
+=
QvNBNBCpTi
KpKcorG
QEA +−
⋅
+= )(11
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Passage du contrôle / commande du process Ballon (continu) en Signal (discret)
Entrée continue : Ex : niveau ballon Bloqueur d’ordre 0 Signal ‘discret’
Discrétisation de la loi de commande
Laplace de variable la est s où E(s)ski
kpU(s) ⋅
+=
retard opérateurl' est où 11
−
−⋅+= zE(z)
zTe
kikpU(z)
∫+⋅= E(t)dt KiE(t) KpU(t)
Échantillonnage des entrées (continues) du contrôle commande
Ex : Le régulateur PI
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Modélisation sous Polychrony du Contrôle Commande Ballon
Période d’échantillonnage
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Génération automatique du code CInterfaçage avec Scicos
Bloqueur d’ordre 0
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Signal d’excitation Simulation du système avec Te = 1s
Simulation sous Scicos
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Simulation du système avec Te = 300s
QEA
Effets de l’augmentation de Te
§ Ecart premier pic§ Apparition d’oscillations amorties§ Non convergence
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Choix de la période d’échantillonnage
§ Ce n’est pas (directement) le théorème de Shannon§ Pour contrôler un process continu en BF avec un régulateur discret, prendre une période d’échantillonnage « petite » devant le temps de réponse du process en BF : 0.01*Tr < Te < 0.1*TrIci : Ballon ? temps de réponse en BF : Tr # 1500 sec. = 25 min? Te=150s, 40s, 15sDès que Te > 100 sec., on observe des perturbations numériques
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Développement UML Signal
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Modélisation suivant la méthodologie ACCORD-UML§ Utilisation de l ’AGL Objecteering + modules ACCORD (CEA)
Principaux éléments du cahier des charges du système : § Acquisition du niveau ballon (capteur niveau)§ Acquisition du débit de perturbation vapeur (capteur débit) § Enregistrement de la consigne de niveau (superviseur)§ Calcul périodique de la commande (vanne)
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Diagrammes structurels du Régulateur du niveau ballon
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Scénario détaillé du cas d’utilisation « Reguler »
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Scénario détaillé du cas d’utilisation « AcquerirNiveauBallon »
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Diagramme comportement de la classe « Regulateur »
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Modélisation en langage Signal « à la main » du contrôle commande du niveau ballon§ Etablissement de correspondances entre modèles UML et Signal
Architecture du programme signal§ Un module par classe§ Un process principal § Structure d’un module :- Un process chart (si la classe a une machine à état) : modélisation du comportement- des process : correspondent aux différentes méthodes de la classe§ Structure du process principal :- un process env_nomDuSysteme
Interface avec l’environnement- un sous process main_nomDuSysteme du process env _nomDuSysteme
Déclaration des statevar (variables d’état correspondant aux attributs)-un sous-process sub_main_nomDuSysteme du process main_nomDuSysteme
Appels des process chart des modules des classes actives
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Ebauche de passerelle UML vers Signal (CS)
Objectifs§ Prise en main de la génération de code sous l’AGL « Objecteering »,§ Début d’exploration d’une voie non-conforme à la sémantique UML des diagrammes d’états-transitions.
Principaux éléments de la spécification de la passerelle§ Génération d’un programme Signal pour le paquetage UML « Core »§ Hypothèse d’une communication du système avec son environnement par signaux exclusivement§ Construction de la structure du programme (similaire à celui de contrôle commande ballon) par l’analyse des diagrammes structurels§ Construction automatique du corps des process « chart » par l’analyse des diagrammes d’états-transitions des classes actives.
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Validation du régulateur ballon écrit en Signal à partir du modèle UML (IRISA SITIA)§ Discrétisation du processus ballon
Bloqueur d’ordre 0Validation sous Matlab SimulinkEcriture Signal
§ Liaison entre le régulateur et le processus
§ Simulation graphique sous l’environnement de Signal (en cours)
Te1 ? QEAcc
CC(Signal)
Te2 ? NBsystem
?(Signal)
QEA
QV
QV
NBC
NB
Statevar
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Développement SynDEx
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Structure du régulateur ballon sous SynDEx (en cours)§ But - Explorer les possibilités de SynDEx en vue de la description de l’application marine- Décrire l’algorithme de régulation et l’architecture existante- Retrouver un temps de cycle conforme à la réalité § Algorithme - Régulateur PI- Alarme sur le niveau qui agit sur la consigne§ Architecture - SNCC : régulateur, automates, poste opérateur (XOPS)..- Temps entre une commande opérateur ? réponse en sortie < 1 sec.
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Algorithme de régulation sous SynDEx
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
MC68060
MC68060
10 Mbits/s
Régulateur ballon
9600 Bd
SNCC du navire à cycle combiné
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
Modélisation partielle de l’architecture
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Manque d’informations
§ Encombrement des bus
§ Encombrement des opérateurs
Ajout de contraintes
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11/07/2002 Analyse et Conception à Objet Temps Réel pour Implantation asynchrone / Synchrone
12721 cycles à 60MHz ? 0.21 ms
Sortie : QEA
Calcul d’adéquation